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FM27C512 Rev. A

Connection Diagrams

Compatible EPROM pin configurations are shown in the blocks adjacement to the FM27C512 pins.

Commercial Temp Range (0

Parameter/Order Number

Access Time (ns)

FM27C512 Q, V 90

90

FM27C512 Q, V 120

120

FM27C512 Q, V 150

150

Industrial Temp Range (-40

Parameter/Order Number

Access Time (ns)

FM27C512 QE, VE 90

90

FM27C512 QE, VE 120

120

FM27C512 QE, VE 150

150

Q = Quartz-Windowed Ceramic DIP Package

V = PLCC Package

• All packages conform to the JEDEC standard.

• All versions are guaranteed to function for slower speeds.

Pin Names

A0–A15

Addresses

CE/PGM

Chip Enable/Program

OE

Output Enable

O0–O7

Outputs

NC

Don’t Care (During Read)

PLCC

DIP

FM27C512

A8

A9

A11

NC

OE/VPP

A10

CE/PGM

O7

O8

A6

A5

A4

A3

A2

A1

A0

NC

O0

5

6

7

8

9

10

11

12

13

29

28

27

26

25

24

23

22

21

14 15 16 17 18 19 20

4

3

2

1 32 31 30

DS800035-2

DS800035-3

A15

A12

A7

A6

A5

A4

A3

A2

A1

A0

O0

O1

O2

GND

VCC

A14

A13

A8

A9

A11

OE/VPP

A10

CE/PGM

O7

O6

O5

O4

O3

1

2

3

4

5

6

7

8

9

10

11

12

13

14

28

27

26

25

24

23

22

21

20

19

18

17

16

15

VCC

XX/PGM

XX

A14

A13

A8

A9

A11

OE

A10

CE

O7

O6

O5

O4

O3

VCC

A14

A13

A8

A9

A11

OE

A10

CE/PGM

O7

O6

O5

O4

O3

27C256 27C010 27C040

VCC

A18

A17

A14

A13

A8

A9

A11

OE

A10

CE/PGM

O7

O6

O5

O4

O3

27C040

27C010 27C256

XX/

VPP

A16

A15

A12

A7

A6

A5

A4

A3

A2

A1

A0

O0

O1

O2

GND

XX/

VPP

A16

A15

A12

A7

A6

A5

A4

A3

A2

A1

A0

O0

O1

O2

GND

VPP

A12

A7

A6

A5

A4

A3

A2

A1

A0

O0

O1

O2

GND